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5 / 62 page  List of Illustrations v November 2002—Revised January 2004 SLES061B List of Illustrations Figure Title Page 2−1 Crystal Circuit 9 . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . 2−2 PLL External Filter 10 . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . 2−3 I2S 64-Fs Format 12 . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . 2−4 I2S 48-Fs Format 12 . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . 2−5 Left-Justified 64-Fs Format 13 . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . 2−6 Left-Justified 48-Fs Format 13 . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . 2−7 Right-Justified 64-Fs Format 14 . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . 2−8 Right-Justified 48-Fs Format 14 . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . 2−9 DSP Format 15 . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . 2−10 Attenuation Curve 19 . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . 2−11 De-Emphasis Filter Characteristics 20 . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . 2−12 PWM Outputs and H-Bridge Driven in BTL Configuration 22 . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . 2−13 Typical I2C Sequence 23 . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . 2−14 Single-Byte Write Transfer 24 . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . 2−15 Multiple-Byte Write Transfer 24 . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . 2−16 Single-Byte Read 24 . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . 2−17 Multiple-Byte Read 24 . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . 4−1 RESET During System Initialization 31 . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . 4−2 Extending the I2C Write Interval Following a Low-to-High Transition of the RESET Terminal 32 . . . . . . . 4−3 Changing the Data Sample Rate Using the DBSPD Terminal 33 . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . 4−4 Changing the Data Sample Rate Using the I2C33 . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . 4−5 Changing the Data Sample Rate With an Unstable MCLK_IN Using the DBSPD Terminal 34 . . . . . . . . . 4−6 Changing the Data Sample Rate With an Unstable MCLK_IN Using the I2C35 . . . . . . . . . . . . . . . . . . . . . 4−7 Changing Between Master and Slave Clock Mode 36 . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . 5−1 RESET Timing 38 . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . 5−2 Power-Down and Power-Up Timing—RESET Preceding PDN 39 . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . 5−3 Power-Down and Power-Up Timing—RESET Following PDN 40 . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . 5−4 Error Recovery Timing 41 . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . 5−5 Mute Timing 41 . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . 5−6 Right-Justified, I2S, Left-Justified Serial Protocol Timing 42 . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . 5−7 Right, Left, and I2S Serial Mode Timing Requirement 43 . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . 5−8 Serial Audio Ports Master Mode Timing 43 . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . 5−9 DSP Serial Port Timing 43 . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . 5−10 DSP Serial Port Expanded Timing 44 . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . 5−11 DSP Absolute Timing 44 . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . 5−12 SCL and SDA Timing 45 . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . 5−13 Start and Stop Conditions Timing 45 . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . 6−1 Typical TAS5036A Application 47 . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . 6−2 TAS5036A Serial Audio Port—Slave Mode Connection Diagram 48 . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . 6−3 TAS5036A Serial Audio Port—Master Mode Connection Diagram 48 . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . |
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