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HYMD232M646CLF6-M Datasheet(PDF) 4 Page - Hynix Semiconductor |
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HYMD232M646CLF6-M Datasheet(HTML) 4 Page - Hynix Semiconductor |
4 / 20 page HYMD232M646C(L)F6-J/M/K/H/L Rev. 0.3 / Apr. 2004 4 FUNCTIONAL BLOCK DIAGRAM /CS0 D0 /CS LDQS LDM I/O 0 I/O 1 I/O 2 I/O 3 I/O 4 I/O 5 I/O 6 I/O 7 UDQS UDM I/O 8 I/O 9 I/O 10 I/O 11 I/O 12 I/O 13 I/O 14 I/O 15 DQ0 DQ1 DQ2 DQ3 DQ4 DQ5 DQ6 DQ7 DM0 DQS0 DQ8 DQ9 DQ10 DQ11 DQ12 DQ13 DQ14 DQ15 DM1 DQS1 D4 /CS LDQS LDM I/O 0 I/O 1 I/O 2 I/O 3 I/O 4 I/O 5 I/O 6 I/O 7 UDQS UDM I/O 8 I/O 9 I/O 10 I/O 11 I/O 12 I/O 13 I/O 14 I/O 15 D1 /CS LDQS LDM I/O 0 I/O 1 I/O 2 I/O 3 I/O 4 I/O 5 I/O 6 I/O 7 UDQS UDM I/O 8 I/O 9 I/O 10 I/O 11 I/O 12 I/O 13 I/O 14 I/O 15 DQ16 DQ17 DQ18 DQ19 DQ20 DQ21 DQ22 DQ23 DM2 DQS2 DQ24 DQ25 DQ26 DQ27 DQ28 DQ29 DQ30 DQ31 DM3 DQS3 D5 /CS LDQS LDM I/O 0 I/O 1 I/O 2 I/O 3 I/O 4 I/O 5 I/O 6 I/O 7 UDQS UDM I/O 8 I/O 9 I/O 10 I/O 11 I/O 12 I/O 13 I/O 14 I/O 15 D2 /CS LDQS LDM I/O 0 I/O 1 I/O 2 I/O 3 I/O 4 I/O 5 I/O 6 I/O 7 UDQS UDM I/O 8 I/O 9 I/O 10 I/O 11 I/O 12 I/O 13 I/O 14 I/O 15 DQ32 DQ33 DQ34 DQ35 DQ36 DQ37 DQ38 DQ39 DM4 DQS4 DQ40 DQ41 DQ42 DQ43 DQ44 DQ45 DQ46 DQ47 DM5 DQS5 D6 /CS LDQS LDM I/O 0 I/O 1 I/O 2 I/O 3 I/O 4 I/O 5 I/O 6 I/O 7 UDQS UDM I/O 8 I/O 9 I/O 10 I/O 11 I/O 12 I/O 13 I/O 14 I/O 15 D3 /CS LDQS LDM I/O 0 I/O 1 I/O 2 I/O 3 I/O 4 I/O 5 I/O 6 I/O 7 UDQS UDM I/O 8 I/O 9 I/O 10 I/O 11 I/O 12 I/O 13 I/O 14 I/O 15 DQ48 DQ49 DQ50 DQ51 DQ52 DQ53 DQ54 DQ55 DM6 DQS6 DQ56 DQ57 DQ58 DQ59 DQ60 DQ61 DQ62 DQ63 DM7 DQS7 D7 /CS LDQS LDM I/O 0 I/O 1 I/O 2 I/O 3 I/O 4 I/O 5 I/O 6 I/O 7 UDQS UDM I/O 8 I/O 9 I/O 10 I/O 11 I/O 12 I/O 13 I/O 14 I/O 15 /CS1 BA0-BA1 SDRAMs D0 – D7 A0 - A12 SDRAMs D0 – D7 /RAS SDRAMs D0 – D7 /CAS SDRAMs D0 – D7 /WE SDRAMs D0 – D7 CKE0 SDRAMs D0 – D3 CKE1 SDRAMz D4 - D7 . VDDSPD VREF VSS VDDID SPD D0 - D7 D0 - D7 D0 - D7 = . = . . = . . . .. Strap:see Note 4 VDD/VDDQ Notes: DQ wiring may differ from that described in this drawing ; however DQ/DM/DQS relationship are maintained as shown. VDDID strap connections; (for memory device VDD, VDDQ) : Strap out :(open) : VDD=VDDQ Strap In (Vss) : VDD= VDDQ Serial PD WP SCL SA0 SA1 SA2 SDA A0 A1 A2 /CS0 D0 /CS LDQS LDM I/O 0 I/O 1 I/O 2 I/O 3 I/O 4 I/O 5 I/O 6 I/O 7 UDQS UDM I/O 8 I/O 9 I/O 10 I/O 11 I/O 12 I/O 13 I/O 14 I/O 15 DQ0 DQ1 DQ2 DQ3 DQ4 DQ5 DQ6 DQ7 DM0 DQS0 DQ8 DQ9 DQ10 DQ11 DQ12 DQ13 DQ14 DQ15 DM1 DQS1 D4 /CS LDQS LDM I/O 0 I/O 1 I/O 2 I/O 3 I/O 4 I/O 5 I/O 6 I/O 7 UDQS UDM I/O 8 I/O 9 I/O 10 I/O 11 I/O 12 I/O 13 I/O 14 I/O 15 D1 /CS LDQS LDM I/O 0 I/O 1 I/O 2 I/O 3 I/O 4 I/O 5 I/O 6 I/O 7 UDQS UDM I/O 8 I/O 9 I/O 10 I/O 11 I/O 12 I/O 13 I/O 14 I/O 15 DQ16 DQ17 DQ18 DQ19 DQ20 DQ21 DQ22 DQ23 DM2 DQS2 DQ24 DQ25 DQ26 DQ27 DQ28 DQ29 DQ30 DQ31 DM3 DQS3 D5 /CS LDQS LDM I/O 0 I/O 1 I/O 2 I/O 3 I/O 4 I/O 5 I/O 6 I/O 7 UDQS UDM I/O 8 I/O 9 I/O 10 I/O 11 I/O 12 I/O 13 I/O 14 I/O 15 D2 /CS LDQS LDM I/O 0 I/O 1 I/O 2 I/O 3 I/O 4 I/O 5 I/O 6 I/O 7 UDQS UDM I/O 8 I/O 9 I/O 10 I/O 11 I/O 12 I/O 13 I/O 14 I/O 15 DQ32 DQ33 DQ34 DQ35 DQ36 DQ37 DQ38 DQ39 DM4 DQS4 DQ40 DQ41 DQ42 DQ43 DQ44 DQ45 DQ46 DQ47 DM5 DQS5 D6 /CS LDQS LDM I/O 0 I/O 1 I/O 2 I/O 3 I/O 4 I/O 5 I/O 6 I/O 7 UDQS UDM I/O 8 I/O 9 I/O 10 I/O 11 I/O 12 I/O 13 I/O 14 I/O 15 D3 /CS LDQS LDM I/O 0 I/O 1 I/O 2 I/O 3 I/O 4 I/O 5 I/O 6 I/O 7 UDQS UDM I/O 8 I/O 9 I/O 10 I/O 11 I/O 12 I/O 13 I/O 14 I/O 15 DQ48 DQ49 DQ50 DQ51 DQ52 DQ53 DQ54 DQ55 DM6 DQS6 DQ56 DQ57 DQ58 DQ59 DQ60 DQ61 DQ62 DQ63 DM7 DQS7 D7 /CS LDQS LDM I/O 0 I/O 1 I/O 2 I/O 3 I/O 4 I/O 5 I/O 6 I/O 7 UDQS UDM I/O 8 I/O 9 I/O 10 I/O 11 I/O 12 I/O 13 I/O 14 I/O 15 /CS1 /CS0 D0 /CS LDQS LDM I/O 0 I/O 1 I/O 2 I/O 3 I/O 4 I/O 5 I/O 6 I/O 7 UDQS UDM I/O 8 I/O 9 I/O 10 I/O 11 I/O 12 I/O 13 I/O 14 I/O 15 DQ0 DQ1 DQ2 DQ3 DQ4 DQ5 DQ6 DQ7 DM0 DQS0 DQ8 DQ9 DQ10 DQ11 DQ12 DQ13 DQ14 DQ15 DM1 DQS1 D4 /CS LDQS LDM I/O 0 I/O 1 I/O 2 I/O 3 I/O 4 I/O 5 I/O 6 I/O 7 UDQS UDM I/O 8 I/O 9 I/O 10 I/O 11 I/O 12 I/O 13 I/O 14 I/O 15 D0 /CS LDQS LDM I/O 0 I/O 1 I/O 2 I/O 3 I/O 4 I/O 5 I/O 6 I/O 7 UDQS UDM I/O 8 I/O 9 I/O 10 I/O 11 I/O 12 I/O 13 I/O 14 I/O 15 DQ0 DQ1 DQ2 DQ3 DQ4 DQ5 DQ6 DQ7 DM0 DQS0 DQ8 DQ9 DQ10 DQ11 DQ12 DQ13 DQ14 DQ15 DM1 DQS1 D4 /CS LDQS LDM I/O 0 I/O 1 I/O 2 I/O 3 I/O 4 I/O 5 I/O 6 I/O 7 UDQS UDM I/O 8 I/O 9 I/O 10 I/O 11 I/O 12 I/O 13 I/O 14 I/O 15 D1 /CS LDQS LDM I/O 0 I/O 1 I/O 2 I/O 3 I/O 4 I/O 5 I/O 6 I/O 7 UDQS UDM I/O 8 I/O 9 I/O 10 I/O 11 I/O 12 I/O 13 I/O 14 I/O 15 DQ16 DQ17 DQ18 DQ19 DQ20 DQ21 DQ22 DQ23 DM2 DQS2 DQ24 DQ25 DQ26 DQ27 DQ28 DQ29 DQ30 DQ31 DM3 DQS3 D5 /CS LDQS LDM I/O 0 I/O 1 I/O 2 I/O 3 I/O 4 I/O 5 I/O 6 I/O 7 UDQS UDM I/O 8 I/O 9 I/O 10 I/O 11 I/O 12 I/O 13 I/O 14 I/O 15 D2 /CS LDQS LDM I/O 0 I/O 1 I/O 2 I/O 3 I/O 4 I/O 5 I/O 6 I/O 7 UDQS UDM I/O 8 I/O 9 I/O 10 I/O 11 I/O 12 I/O 13 I/O 14 I/O 15 DQ32 DQ33 DQ34 DQ35 DQ36 DQ37 DQ38 DQ39 DM4 DQS4 DQ40 DQ41 DQ42 DQ43 DQ44 DQ45 DQ46 DQ47 DM5 DQS5 D6 /CS LDQS LDM I/O 0 I/O 1 I/O 2 I/O 3 I/O 4 I/O 5 I/O 6 I/O 7 UDQS UDM I/O 8 I/O 9 I/O 10 I/O 11 I/O 12 I/O 13 I/O 14 I/O 15 D2 /CS LDQS LDM I/O 0 I/O 1 I/O 2 I/O 3 I/O 4 I/O 5 I/O 6 I/O 7 UDQS UDM I/O 8 I/O 9 I/O 10 I/O 11 I/O 12 I/O 13 I/O 14 I/O 15 DQ32 DQ33 DQ34 DQ35 DQ36 DQ37 DQ38 DQ39 DM4 DQS4 DQ40 DQ41 DQ42 DQ43 DQ44 DQ45 DQ46 DQ47 DM5 DQS5 D6 /CS LDQS LDM I/O 0 I/O 1 I/O 2 I/O 3 I/O 4 I/O 5 I/O 6 I/O 7 UDQS UDM I/O 8 I/O 9 I/O 10 I/O 11 I/O 12 I/O 13 I/O 14 I/O 15 D3 /CS LDQS LDM I/O 0 I/O 1 I/O 2 I/O 3 I/O 4 I/O 5 I/O 6 I/O 7 UDQS UDM I/O 8 I/O 9 I/O 10 I/O 11 I/O 12 I/O 13 I/O 14 I/O 15 DQ48 DQ49 DQ50 DQ51 DQ52 DQ53 DQ54 DQ55 DM6 DQS6 DQ56 DQ57 DQ58 DQ59 DQ60 DQ61 DQ62 DQ63 DM7 DQS7 D7 /CS LDQS LDM I/O 0 I/O 1 I/O 2 I/O 3 I/O 4 I/O 5 I/O 6 I/O 7 UDQS UDM I/O 8 I/O 9 I/O 10 I/O 11 I/O 12 I/O 13 I/O 14 I/O 15 /CS1 BA0-BA1 SDRAMs D0 – D7 A0 - A12 SDRAMs D0 – D7 /RAS SDRAMs D0 – D7 /CAS SDRAMs D0 – D7 /WE SDRAMs D0 – D7 CKE0 SDRAMs D0 – D3 CKE1 SDRAMz D4 - D7 BA0-BA1 SDRAMs D0 – D7 A0 - A12 SDRAMs D0 – D7 /RAS SDRAMs D0 – D7 /CAS SDRAMs D0 – D7 /WE SDRAMs D0 – D7 CKE0 SDRAMs D0 – D3 CKE1 SDRAMz D4 - D7 . VDDSPD VREF VSS VDDID SPD D0 - D7 D0 - D7 D0 - D7 = . = . . = . . . .. Strap:see Note 4 VDD/VDDQ . VDDSPD VREF VSS VDDID SPD D0 - D7 D0 - D7 D0 - D7 = . = . . = . . . .. Strap:see Note 4 VDD/VDDQ Notes: DQ wiring may differ from that described in this drawing ; however DQ/DM/DQS relationship are maintained as shown. VDDID strap connections; (for memory device VDD, VDDQ) : Strap out :(open) : VDD=VDDQ Strap In (Vss) : VDD= VDDQ Serial PD WP SCL SA0 SA1 SA2 SDA A0 A1 A2 Serial PD WP SCL SA0 SA1 SA2 SDA A0 A1 A2 |
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