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ADSP-2186MKST-300 Datasheet(PDF) 2 Page - Analog Devices |
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2 / 40 page  REV. 0 –2– ADSP-2186M TABLE OF CONTENTS FEATURES . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . 1 FUNCTIONAL BLOCK DIAGRAM . . . . . . . . . . . . . . . . 1 GENERAL DESCRIPTION . . . . . . . . . . . . . . . . . . . . . . . . 3 DEVELOPMENT SYSTEM . . . . . . . . . . . . . . . . . . . . . . . 3 Additional Information . . . . . . . . . . . . . . . . . . . . . . . . . . 3 ARCHITECTURE OVERVIEW . . . . . . . . . . . . . . . . . . . . 4 Serial Ports . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . 5 PIN DESCRIPTIONS . . . . . . . . . . . . . . . . . . . . . . . . . . . . 5 Common-Mode Pins . . . . . . . . . . . . . . . . . . . . . . . . . . . . 6 Memory Interface Pins . . . . . . . . . . . . . . . . . . . . . . . . . . . 7 Full Memory Mode Pins (Mode C = 0) . . . . . . . . . . . . . . 7 Host Mode Pins (Mode C = 1) . . . . . . . . . . . . . . . . . . . . 7 Terminating Unused Pins . . . . . . . . . . . . . . . . . . . . . . . . 8 Pin Terminations . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . 8 Interrupts . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . 9 LOW POWER OPERATION . . . . . . . . . . . . . . . . . . . . . . . 9 Power-Down . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . 9 Idle . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . 9 Slow Idle . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . 10 SYSTEM INTERFACE . . . . . . . . . . . . . . . . . . . . . . . . . . 10 Clock Signals . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . 10 RESET . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . 11 Power Supplies . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . 11 MODES OF OPERATION . . . . . . . . . . . . . . . . . . . . . . . 11 Setting Memory Mode . . . . . . . . . . . . . . . . . . . . . . . . . . 11 Passive Configuration . . . . . . . . . . . . . . . . . . . . . . . . . . . 11 Active Configuration . . . . . . . . . . . . . . . . . . . . . . . . . . . 12 IACK Configuration . . . . . . . . . . . . . . . . . . . . . . . . . . . 12 MEMORY ARCHITECTURE . . . . . . . . . . . . . . . . . . . . . 12 Program Memory . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . 12 Data Memory . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . 13 Memory Mapped Registers (New to the ADSP-2186M) . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . 13 I/O Space (Full Memory Mode) . . . . . . . . . . . . . . . . . . . 13 Composite Memory Select ( CMS) . . . . . . . . . . . . . . . . . 14 Byte Memory Select ( BMS) . . . . . . . . . . . . . . . . . . . . . . 14 Byte Memory . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . 14 Byte Memory DMA (BDMA, Full Memory Mode) . . . . 14 Internal Memory DMA Port (IDMA Port; Host Memory Mode) . . . . . . . . . . . . . . 15 Bootstrap Loading (Booting) . . . . . . . . . . . . . . . . . . . . . 15 IDMA Port Booting . . . . . . . . . . . . . . . . . . . . . . . . . . . . 16 Bus Request and Bus Grant . . . . . . . . . . . . . . . . . . . . . . 16 Flag I/O Pins . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . 16 Instruction Set Description . . . . . . . . . . . . . . . . . . . . . . 16 DESIGNING AN EZ-ICE-COMPATIBLE SYSTEM . . . 16 Target Board Connector for EZ-ICE Probe . . . . . . . . . . 17 Target Memory Interface . . . . . . . . . . . . . . . . . . . . . . . . 17 PM, DM, BM, IOM, AND CM . . . . . . . . . . . . . . . . . . . . 17 Target System Interface Signals . . . . . . . . . . . . . . . . . . . 17 RECOMMENDED OPERATING CONDITIONS . . . . . 18 ELECTRICAL CHARACTERISTICS . . . . . . . . . . . . . . . 18 ABSOLUTE MAXIMUM RATINGS . . . . . . . . . . . . . . . 19 TIMING SPECIFICATIONS . . . . . . . . . . . . . . . . . . . . . 19 GENERAL NOTES . . . . . . . . . . . . . . . . . . . . . . . . . . . . . 19 TIMING NOTES . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . 19 MEMORY TIMING SPECIFICATIONS . . . . . . . . . . . . 19 FREQUENCY DEPENDENCY FOR TIMING SPECIFICATIONS . . . . . . . . . . . . . . . . . . . . 20 ENVIRONMENTAL CONDITIONS . . . . . . . . . . . . . . . 20 POWER DISSIPATION . . . . . . . . . . . . . . . . . . . . . . . . . . 20 Output Drive Currents . . . . . . . . . . . . . . . . . . . . . . . . . . 20 Capacitive Loading . . . . . . . . . . . . . . . . . . . . . . . . . . . . 21 TEST CONDITIONS . . . . . . . . . . . . . . . . . . . . . . . . . . . 22 Output Disable Time . . . . . . . . . . . . . . . . . . . . . . . . . . . 22 Output Enable Time . . . . . . . . . . . . . . . . . . . . . . . . . . . 22 Clock Signals and Reset . . . . . . . . . . . . . . . . . . . . . . . . . 23 Interrupts and Flags . . . . . . . . . . . . . . . . . . . . . . . . . . . . 24 Bus Request–Bus Grant . . . . . . . . . . . . . . . . . . . . . . . . . 25 Memory Read . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . 26 Memory Write . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . 27 Serial Ports . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . 28 IDMA Address Latch . . . . . . . . . . . . . . . . . . . . . . . . . . . 29 IDMA Write, Short Write Cycle . . . . . . . . . . . . . . . . . . 30 IDMA Write, Long Write Cycle . . . . . . . . . . . . . . . . . . . 31 IDMA Read, Long Read Cycle . . . . . . . . . . . . . . . . . . . 32 IDMA Read, Short Read Cycle . . . . . . . . . . . . . . . . . . . 33 IDMA Read, Short Read Cycle in Short Read Only Mode . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . 34 100-LEAD LQFP PIN CONFIGURATION . . . . . . . . . . 35 LQFP Package Pinout . . . . . . . . . . . . . . . . . . . . . . . . . . . . 36 144-Ball Mini-BGA Package Pinout . . . . . . . . . . . . . . . . . 37 Mini-BGA Package Pinout . . . . . . . . . . . . . . . . . . . . . . . . 38 OUTLINE DIMENSIONS 100-Lead Metric Thin Plastic Quad Flatpack (LQFP) (ST-100) . . . . . . . . . . . . . . . . . . . . . . . . . . . 39 OUTLINE DIMENSIONS 144-Ball Mini-BGA (CA-144) . . . . . . . . . . . . . . . . . . . . 40 ORDERING GUIDE . . . . . . . . . . . . . . . . . . . . . . . . . . . . 40 Tables Table I. Interrupt Priority and Interrupt Vector Addresses . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . 9 Table II. Modes of Operation . . . . . . . . . . . . . . . . . . . . . . 11 Table III. PMOVLAY Bits . . . . . . . . . . . . . . . . . . . . . . . . 12 Table IV. DMOVLAY Bits . . . . . . . . . . . . . . . . . . . . . . . . 13 Table V. Wait States . . . . . . . . . . . . . . . . . . . . . . . . . . . . . 14 Table VI. Data Formats . . . . . . . . . . . . . . . . . . . . . . . . . . 14 |
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