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TLC34076 Datasheet(PDF) 3 Page - Texas Instruments |
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3 / 68 page  iii Contents Section Title Page 1 Introduction 1–1 . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . 1.1 Features 1–1 . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . 1.2 Functional Block Diagram 1–3 . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . 1.3 Terminal Assignments 1–4 . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . 1.4 Ordering Information 1–7 . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . 1.5 Terminal Functions (TLC34076C and TLC34076M) 1–8 . . . . . . . . . . . . . . . . . . . . . . . . . 2 Detailed Description 2–1 . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . 2.1 Microprocessor Unit (MPU) Interface 2–1 . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . 2.2 Color Palette RAM 2–1 . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . 2.2.1 Writing to the Color Palette RAM 2–2 . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . 2.2.2 Reading From the Color Palette RAM 2–2 . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . 2.2.3 Palette Page Register 2–2 . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . 2.3 Input/Output Clock Selection and Generation 2–2 . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . 2.3.1 SCLK 2–5 . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . 2.3.2 VCLK 2–6 . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . 2.4 Multiplexing Scheme 2–8 . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . 2.4.1 VGA Pass-Through Mode 2–11 . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . 2.4.2 Multiplexing Modes 2–12 . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . 2.4.3 Special Nibble Mode 2–12 . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . 2.4.4 True-Color Modes 2–12 . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . 2.4.5 Multiplex Control Register 2–15 . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . 2.4.6 Read Masking 2–16 . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . 2.5 Reset 2–16 . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . 2.5.1 Power-On Reset 2–16 . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . 2.5.2 Hardware Reset 2–16 . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . 2.5.3 Software Reset 2–16 . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . 2.5.4 VGA Pass-Through Mode Default Conditions 2–17 . . . . . . . . . . . . . . . . . . . . . . . 2.6 Analog Output Specifications 2–17 . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . 2.7 Frame-Buffer Interface with Little-Endian and Big-Endian Modes 2–19 . . . . . . . . . . . . 2.8 HSYNC, VSYNC, and BLANK 2–19 . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . 2.9 Split Shift Register Transfer VRAMs and Special Nibble Mode 2–20 . . . . . . . . . . . . . . 2.9.1 Split Shift Register Transfer VRAMs 2–20 . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . 2.9.2 Special Nibble Mode 2–21 . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . 2.10 MUXOUT Output 2–23 . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . 2.11 General Control Register 2–23 . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . 2.11.1 HSYNCOUT and VSYNCOUT (Bits 0 and 1) 2–23 . . . . . . . . . . . . . . . . . . . . . . . 2.11.2 Split Shift Register Transfer Enable (SSRT) and Special Nibble Mode Enable (SNM) (Bits 2 and 3) 2–23 . . . . . . . . . . . . . . . . . . . 2.11.3 Pedestal Enable Control (Bit 4) 2–23 . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . 2.11.4 Sync Enable Control (Bit 5) 2–24 . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . |
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