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MC68HC908EY16 Datasheet(PDF) 9 Page - Motorola, Inc |
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MC68HC908EY16 Datasheet(HTML) 9 Page - Motorola, Inc |
9 / 416 page Table of Contents 68HC908EY16 — Rev 2.0 Advance Information MOTOROLA Table of Contents 9 Section 5. Central Processor Unit (CPU) 5.1 Contents . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . 69 5.2 Introduction . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . 70 5.3 Features . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . 70 5.4 CPU Registers . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . 71 5.4.1 Accumulator . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . .71 5.4.2 Index Register . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . 72 5.4.3 Stack Pointer . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . 73 5.4.4 Program Counter . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . 74 5.4.5 Condition Code Register . . . . . . . . . . . . . . . . . . . . . . . . . . .75 5.5 Arithmetic/Logic Unit (ALU) . . . . . . . . . . . . . . . . . . . . . . . . . . .77 5.6 Low-Power Modes . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . .77 5.6.1 Wait Mode . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . 77 5.6.2 Stop Mode . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . 77 5.7 CPU During Break Interrupts . . . . . . . . . . . . . . . . . . . . . . . . . . 78 5.8 Instruction Set Summary . . . . . . . . . . . . . . . . . . . . . . . . . . . . . 78 5.9 Opcode Map . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . 85 Section 6. System Integration Module (SIM) 6.1 Contents . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . 87 6.2 Introduction . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . 88 6.3 SIM Bus Clock Control and Generation . . . . . . . . . . . . . . . . . . 90 6.3.1 Bus Timing . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . 90 6.3.2 Clock Startup from POR or LVI Reset . . . . . . . . . . . . . . . . . 90 6.3.3 Clocks in Stop Mode and Wait Mode . . . . . . . . . . . . . . . . . . 91 6.4 Reset and System Initialization. . . . . . . . . . . . . . . . . . . . . . . . . 91 6.4.1 External Pin Reset . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . 92 6.4.2 Active Resets from Internal Sources . . . . . . . . . . . . . . . . . . 93 6.4.2.1 Power-On Reset . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . 94 6.4.2.2 Computer Operating Properly (COP) Reset. . . . . . . . . . . 95 6.4.2.3 Illegal Opcode Reset . . . . . . . . . . . . . . . . . . . . . . . . . . . . 95 |
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