W3DG72256V10D2 datasheet(2/6 Pages) WEDC

Part #	W3DG72256V10D2

Description	2GB - 256Mx72 SDRAM, REGISTER and SPD, w/PLL

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Manufacturer	WEDC [White Electronic Designs Corporation]

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W3DG72256V-D2

2

White Electronic Designs Corporation • (602) 437-1520 • www.wedc.com

White Electronic Designs

August 2005

Rev. 3

FUNCTIONAL BLOCK DIAGRAM

REGE

PCK

DQ0

DQ1

DQ2

DQ3

DQ4

DQ5

DQ6

DQ7

DQ8

DQ9

DQ10

DQ11

DQ12

DQ13

DQ14

DQ15

DQM CS

I/O 0

I/O 1

I/O 2

I/O 3

DQM CS

I/O 0

I/O 1

I/O 2

I/O 3

DQM CS

I/O 0

I/O 1

I/O 2

I/O 3

DQM CS

I/O 0

I/O 1

I/O 2

I/O 3

CS0#

DQMB0

DQM CS

I/O 0

I/O 1

I/O 2

I/O 3

DQM CS

I/O 0

I/O 1

I/O 2

I/O 3

DQM CS

I/O 0

I/O 1

I/O 2

I/O 3

DQM CS

I/O 0

I/O 1

I/O 2

I/O 3

DQ32

DQ33

DQ34

DQ35

DQ36

DQ37

DQ38

DQ39

DQ40

DQ41

DQ42

DQ43

DQ44

DQ45

DQ46

DQ47

DQM

CS

I/O 0

I/O 1

I/O 2

I/O 3

DQM

CS

I/O 0

I/O 1

I/O 2

I/O 3

DQM

CS

I/O 0

I/O 1

I/O 2

I/O 3

DQM

CS

I/O 0

I/O 1

I/O 2

I/O 3

DQMB4

DQM

CS

I/O 0

I/O 1

I/O 2

I/O 3

DQM

CS

I/O 0

I/O 1

I/O 2

I/O 3

DQM

CS

I/O 0

I/O 1

I/O 2

I/O 3

DQM

CS

I/O 0

I/O 1

I/O 2

I/O 3

DQMB1

DQMB5

DQ16

DQ17

DQ18

DQ19

DQ20

DQ21

DQ22

DQ23

DQ24

DQ25

DQ26

DQ27

DQ28

DQ29

DQ30

DQ31

DQM CS

I/O 0

I/O 1

I/O 2

I/O 3

DQM CS

I/O 0

I/O 1

I/O 2

I/O 3

DQM CS

I/O 0

I/O 1

I/O 2

I/O 3

DQM CS

I/O 0

I/O 1

I/O 2

I/O 3

DQMB2

DQM CS

I/O 0

I/O 1

I/O 2

I/O 3

DQM CS

I/O 0

I/O 1

I/O 2

I/O 3

DQM CS

I/O 0

I/O 1

I/O 2

I/O 3

DQM CS

I/O 0

I/O 1

I/O 2

I/O 3

DQ48

DQ49

DQ50

DQ51

DQ52

DQ53

DQ54

DQ55

DQ56

DQ57

DQ58

DQ59

DQ60

DQ61

DQ62

DQ63

DQM

CS

I/O 0

I/O 1

I/O 2

I/O 3

DQM

CS

I/O 0

I/O 1

I/O 2

I/O 3

DQM

CS

I/O 0

I/O 1

I/O 2

I/O 3

DQM

CS

I/O 0

I/O 1

I/O 2

I/O 3

DQMB6

DQM

CS

I/O 0

I/O 1

I/O 2

I/O 3

DQM

CS

I/O 0

I/O 1

I/O 2

I/O 3

DQM

CS

I/O 0

I/O 1

I/O 2

I/O 3

DQM

CS

I/O 0

I/O 1

I/O 2

I/O 3

DQMB3

DQMB7

VCC

VSS

SDRAMs

CB0

CB1

CB2

CB3

DQM CS

I/O 0

I/O 1

I/O 2

I/O 3

DQM CS

I/O 0

I/O 1

I/O 2

I/O 3

CB4

CB5

CB6

CB7

DQM

CS

I/O 0

I/O 1

I/O 2

I/O 3

DQM

CS

I/O 0

I/O 1

I/O 2

I/O 3

* Wire per Clock Loading Table/Wiring Diagrams

NOTE: DQ wiring may differ than described in

this drawing, however DQ/DQMB/CKE/S

relationships must be maintained as shown.

RAS#: SDRAMS

CAS#: SDRAMS

CKE0: SDRAMS

WE#: SDRAMS

CS0#-CS3#

DQMB0 to DQMB7

BA0-BA1

A0-A12

RAS#

CAS#

CKE0

WE#

CKE1

RS0#-RS3#

RDQMB0-RDQMB7

RRAS#

RCAS#

RCKE0

RCKE1

RWE#

R

E

G

I

S

T

E

R

CKE1: SDRAMS

CS1#

CS2#

CS3#

#

RBA0-RBA1

RA0-RA12

BA0-BA1: SDRAMS

A0-A12: SDRAMS

A0

SERIAL PD

A1

A2

SA0

SA1

SA2

SCL

SDA

CK0

CK1-CK3

12pF

PLL

REGISTER

SDRAM

12pF

NOTE: All resistor values are 10 ohms.

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