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TMS320C6412AZDKA5 Datasheet(PDF) 7 Page - Texas Instruments |
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TMS320C6412AZDKA5 Datasheet(HTML) 7 Page - Texas Instruments |
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7 / 163 page  Figures 7 April 2003 − Revised October 2010 SPRS219J List of Figures Figure Page 1−1 GDK and ZDK BGA Packages (Bottom View) 15 . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . 1−2 GNZ and ZNZ BGA Packages (Bottom View) 15 . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . 1−3 Functional Block Diagram 18 . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . 1−4 TMS320C64xE CPU (DSP Core) Data Paths 21 . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . 1−5 TMS320C6412 L2 Architecture Memory Configuration 24 . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . 1−6 CPU and Peripheral Signals 42 . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . 1−7 Peripheral Signals 43 . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . 2−1 Peripheral Configuration Register (PERCFG) [Address Location: 0x01B3F000 − 0x01B3F003] 49 . . . . 2−2 Peripheral Enable/Disable Flow Diagram 50 . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . 2−3 PCFGLOCK Register Diagram [Address Location: 0x01B3 F018] − Read/Write Accesses 51 . . . . . . . . 2−4 Device Status Register (DEVSTAT) Description − 0x01B3 F004 52 . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . 2−5 JTAG ID Register Description − TMS320C6412 Register Value − 0x0007 902F 53 . . . . . . . . . . . . . . . . . . 2−6 Configuration Example (2 McBSPs + EMAC + MDIO + I2C0 + EMIF + HPI + 3 Timers) 57 . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . 2−7 TMS320C64xE DSP Device Nomenclature (Including the TMS320C6412 Device) 83 . . . . . . . . . . . . . . . 2−8 External PLL Circuitry for Either PLL Multiply Modes or x1 (Bypass) Mode 86 . . . . . . . . . . . . . . . . . . . . . . 2−9 I2C0 Module Block Diagram 88 . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . 2−10 GPIO Enable Register (GPEN) [Hex Address: 01B0 0000] 92 . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . 2−11 GPIO Direction Register (GPDIR) [Hex Address: 01B0 0004] 92 . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . 2−12 Power-Down Mode Logic† 93 . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . 2−13 PWRD Field of the CSR Register 94 . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . 2−14 Schottky Diode Diagram 96 . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . 4−1 Test Load Circuit for AC Timing Measurements 102 . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . 4−2 Input and Output Voltage Reference Levels for AC Timing Measurements 102 . . . . . . . . . . . . . . . . . . . . . 4−3 Rise and Fall Transition Time Voltage Reference Levels 102 . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . 4−4 AC Transient Specification Rise Time 103 . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . 4−5 AC Transient Specification Fall Time 103 . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . 4−6 Board-Level Input/Output Timings 104 . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . 4−7 CLKIN Timing 106 . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . 4−8 CLKOUT4 Timing 106 . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . 4−9 CLKOUT6 Timing 107 . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . 4−10 AECLKIN Timing for EMIFA 108 . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . 4−11 AECLKOUT1 Timing for EMIFA Module 108 . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . 4−12 AECLKOUT2 Timing for the EMIFA Module 109 . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . 5−1 Asynchronous Memory Read Timing for EMIFA 111 . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . 5−2 Asynchronous Memory Write Timing for EMIFA 112 . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . |
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