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TMS320VC5509A Datasheet(PDF) 10 Page - Texas Instruments |
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TMS320VC5509A Datasheet(HTML) 10 Page - Texas Instruments |
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10 / 145 page  Tables 10 November 2002 − Revised January 2008 SPRS205K List of Tables Table Page 2−1 Pin Assignments for the GHH and ZHH Packages 16 . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . 2−2 Pin Assignments for the PGE Package 18 . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . 2−3 Signal Descriptions 19 . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . 3−1 DARAM Blocks 32 . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . 3−2 SARAM Blocks 32 . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . 3−3 Boot Configuration Summary 36 . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . 3−4 Synchronization Control Function 38 . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . 3−5 External Bus Selection Register Bit Field Description 40 . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . 3−6 TMS320VC5509A Parallel Port Signal Routing 42 . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . 3−7 TMS320VC5509A Serial Port1 Signal Routing 45 . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . 3−8 TMS320VC5509A Serial Port2 Signal Routing 45 . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . 3−9 I/O Direction Register (IODIR) Bit Functions 46 . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . 3−10 I/O Data Register (IODATA) Bit Functions 47 . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . 3−11 Address/GPIO Enable Register (AGPIOEN) Bit Functions 47 . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . 3−12 Address/GPIO Direction Register (AGPIODIR) Bit Functions 48 . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . 3−13 Address/GPIO Data Register (AGPIODATA) Bit Functions 48 . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . 3−14 EHPI GPIO Enable Register (EHPIGPIOEN) Bit Functions 49 . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . 3−15 EHPI GPIO Direction Register (EHPIGPIODIR) Bit Functions 49 . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . 3−16 EHPI GPIO Data Register (EHPIGPIODATA) Bit Functions 50 . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . 3−17 System Register Bit Fields 51 . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . 3−18 USB PLL Selection and Status Register Bit Functions 52 . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . 3−19 USB APLL Clock Mode Register Bit Functions 52 . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . 3−20 M and D Values Based on MODE, DIV, and K 53 . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . 3−21 CPU Memory-Mapped Registers 54 . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . 3−22 Idle Control, Status, and System Registers 56 . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . 3−23 External Memory Interface Registers 56 . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . 3−24 DMA Configuration Registers 57 . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . 3−25 Real-Time Clock Registers 63 . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . 3−26 Clock Generator 63 . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . 3−27 Timers 63 . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . 3−28 Multichannel Serial Port #0 64 . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . 3−29 Multichannel Serial Port #1 65 . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . 3−30 Multichannel Serial Port #2 66 . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . 3−31 GPIO 67 . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . 3−32 Device Revision ID 67 . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . 3−33 I2C Module Registers 67 . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . 3−34 Watchdog Timer Registers 68 . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . 3−35 MMC/SD1 Module Registers 68 . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . 3−36 MMC/SD2 Module Registers 69 . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . 3−37 USB Module Registers 70 . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . 3−38 Analog-to-Digital Controller (ADC) Registers 72 . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . 3−39 External Bus Selection Register 72 . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . 3−40 Interrupt Table 73 . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . 3−41 IFR0 and IER0 Register Bit Fields 74 . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . 3−42 IFR1 and IER1 Register Bit Fields 75 . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . |
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