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TMS320VC5510 Datasheet(PDF) 7 Page - Texas Instruments |
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TMS320VC5510 Datasheet(HTML) 7 Page - Texas Instruments |
7 / 90 page Figures 7 June 2000 − Revised September 2007 SPRS076O List of Figures Figure Page 2−1 TMS320VC5510/5510A GGW and ZGW MicroStar BGA Packages (Bottom View) 13 . . . . . . . . . . . . 3−1 TMS320VC5510/5510A Functional Block Diagram 22 . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . 3−2 TMS320VC5510/5510A Memory Map 25 . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . 3−3 System Register (SYSR) Bit Layout 27 . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . 3−4 EHPI Memory Map 29 . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . 3−5 I/O Direction Register (IODIR) Bit Layout 31 . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . 3−6 I/O Data Register (IODATA) Bit Layout 31 . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . 3−7 IFR0, IER0, DBIFR0, and DBIER0 Bit Locations 45 . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . 3−8 IFR1, IER1, DBIFR1, and DBIER1 Bit Locations 45 . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . 4−1 Device Nomenclature for the TMS320VC5510/5510A 49 . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . 5−1 3.3-V Test Load Circuit 52 . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . 5−2 Bypass Mode Clock Timing 53 . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . 5−3 External Multiply-by-N Clock Timing 54 . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . 5−4 Asynchronous Memory Read Timing 56 . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . 5−5 Asynchronous Memory Write Timing 57 . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . 5−6 SBSRAM Read Timing 59 . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . 5−7 SBSRAM Write Timing 59 . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . 5−8 Two SDRAM Read Commands (Active Row) 61 . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . 5−9 Two SDRAM WRT Commands (Active Row) 61 . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . 5−10 SDRAM ACTV Command 62 . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . 5−11 SDRAM DCAB Command 62 . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . 5−12 SDRAM REFR Command 63 . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . 5−13 SDRAM MRS Command 63 . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . 5−14 HOLD/HOLDA Timing 64 . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . 5−15 Reset Timing 65 . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . 5−16 External Interrupt Timing 66 . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . 5−17 XF Timing 67 . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . 5−18 General-Purpose Input/Output (IOx) Signal Timings 68 . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . 5−19 TIN/TOUT Timing When Configured as Inputs 69 . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . 5−20 TIN/TOUT Timing When Configured as Outputs 69 . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . 5−21 McBSP Receive Timings 72 . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . 5−22 McBSP Transmit Timings 72 . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . 5−23 McBSP General-Purpose I/O Timings 73 . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . 5−24 McBSP Timing as SPI Master or Slave: CLKSTP = 10b, CLKXP = 0 75 . . . . . . . . . . . . . . . . . . . . . . . . 5−25 McBSP Timing as SPI Master or Slave: CLKSTP = 11b, CLKXP = 0 76 . . . . . . . . . . . . . . . . . . . . . . . . |
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